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基于FPGA 的解串器參考設(shè)計與實現(xiàn)

出處:電子設(shè)計應(yīng)用 發(fā)布于:2011-09-02 16:00:56

  日前,德州儀器 (TI) 與可編程邏輯解決方案的供應(yīng)商賽靈思公司 (Xilinx) 聯(lián)合宣布推出基于 FPGA 的解串器參考設(shè)計,該設(shè)計由 TI 與 Xilinx 聯(lián)合開發(fā)而成。這款全新的參考設(shè)計能夠?qū)?TI ADS527x 模數(shù)轉(zhuǎn)換器 (ADC) 系列的碼流進行解串,其附帶的應(yīng)用手冊可為設(shè)計人員介紹一種快速而簡便的解決方案。ADC,Analog-to-Digital Converter的縮寫,指模/數(shù)轉(zhuǎn)換器或者模擬/數(shù)字轉(zhuǎn)換器。真實世界的模擬信號,例如溫度、壓力、聲音或者圖像等,需要轉(zhuǎn)換成更容易儲存、處理和發(fā)射的數(shù)字形式。模/數(shù)轉(zhuǎn)換器可以實現(xiàn)這個功能,在各種不同的產(chǎn)品中都可以找到它的身影。

  如今,系統(tǒng)設(shè)計人員能夠高效利用 FPGA 的串行/并行處理能力以及軟件可編程性,加速專用的高性能處理功能的操作進程。目前以硬件描述語言(Verilog 或 VHDL)所完成的電路設(shè)計,可以經(jīng)過簡單的綜合與布局,快速的燒錄至 FPGA 上進行測試,是現(xiàn)代IC設(shè)計驗證的技術(shù)主流。這些可編輯元件可以被用來實現(xiàn)一些基本的邏輯門電路(比如AND、OR、XOR、NOT)或者更復雜一些的組合功能比如解碼器或數(shù)學方程式。在大多數(shù)的FPGA里面,這些可編輯的元件里也包含記憶元件例如觸發(fā)器(Flip-flop)或者其他更加完整的記憶塊。對于超聲波、儀表以及無線通信等多通道應(yīng)用而言,擁有更高總體系統(tǒng)性能的能力尤為重要。FPGA一般來說比ASIC(專用集成芯片)的速度要慢,無法完成復雜的設(shè)計,而且消耗更多的電能。但是他們也有很多的優(yōu)點比如可以快速成品,可以被修改來改正程序中的錯誤和更便宜的造價。廠商也可能會提供便宜的但是編輯能力差的FPGA。因為這些芯片有比較差的可編輯能力,所以這些設(shè)計的開發(fā)是在普通的FPGA上完成的,然后將設(shè)計轉(zhuǎn)移到一個類似于ASIC的芯片上。另外一種方法是用CPLD(復雜可編程邏輯器件備)。

  高性能LVDS接口

  LVDS技術(shù)擁有330mV的低壓差分信號(250mVMINand450mVMAX)和快速過渡時間。這可以讓產(chǎn)品達到自100Mbps至超過1Gbps的高數(shù)據(jù)速率。此外,這種低壓擺幅可以降低功耗消散,同時具備差分傳輸?shù)膬?yōu)點。 LVDS技術(shù)用于簡單的線路驅(qū)動器和接收器物理層器件以及比較復雜的接口通信芯片組。通道鏈路芯片組多路復用和解多路復用慢速TTL信號線路以提供窄式高速低功耗LVDS接口。這些芯片組可以大幅節(jié)省系統(tǒng)的電纜和連接器成本,并且可以減少連接器所占面積所需的物理空間。LVDS解決方案為設(shè)計人員解決高速I/O接口問題提供了新選擇。LVDS為當今和未來的高帶寬數(shù)據(jù)傳輸應(yīng)用提供毫瓦每千兆位的方案。

  更先進的總線LVDS(BLVDS)是在LVDS基礎(chǔ)上面發(fā)展起來的,總線LVDS(BLVDS)是基于LVDS技術(shù)的總線接口電路的一個新系列,專門用于實現(xiàn)多點電纜或背板應(yīng)用。它不同于標準的LVDS,提供增強的驅(qū)動電流,以處理多點應(yīng)用中所需的雙重傳輸。BLVDS具備大約250mV的低壓差分信號以及快速的過渡時間。這可以讓產(chǎn)品達到自100Mbps至超過1Gbps的高數(shù)據(jù)傳輸速率。此外,低電壓擺幅可以降低功耗和噪聲至化。差分數(shù)據(jù)傳輸配置提供有源總線的+/-1V共模范圍和熱插拔器件。

  該解串器參考設(shè)計可同時接受多達 8 個通道,并且能提供自動的通道校正與時鐘調(diào)整功能。每個 ADC 輸出均可通過單獨的 LVDS 雙串行進行串行化與傳輸。另外,該解串器參考設(shè)計還可提供獨立的幀時鐘與串行數(shù)據(jù)時鐘,進行輕松解串。

  串行LVDS接口格式為系統(tǒng)制造商提供了幾種顯而易見的優(yōu)勢。同時,ADC 與 FPGA 上較少的引腳數(shù)意味著所需的路由線路更少,電路板成本更低。LVDS 接口本身是一種差動電流模式接口,不僅能夠提供抗外部噪聲能力,而且還能在印刷電路板中實現(xiàn)極低的串擾噪聲。



  

參考文獻:

[1]. CPLD datasheet http://hbjingang.com/datasheet/CPLD_1136600.html.
[2]. LVDS datasheet http://hbjingang.com/datasheet/LVDS_457917.html.
[3]. TTL datasheet http://hbjingang.com/datasheet/TTL_1174409.html.


關(guān)鍵詞:FPGA

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