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儀器測(cè)量中靈敏度/分辨率的挑戰(zhàn)
持人們熟知的windows操作系統(tǒng)所特有的點(diǎn)－擊、剪切－粘貼和拖－放功能。這些系統(tǒng)功能可以縮短學(xué)習(xí)曲線(xiàn)，從而讓測(cè)試的建立、執(zhí)行和分析在時(shí)間上更富有效率。第三個(gè)測(cè)試方面的挑戰(zhàn)是靈敏度和分辨率。儀器的靈敏度一般是由其最低的測(cè)量范圍除以分辨率來(lái)量度的。分辨率是可以觀察到的信號(hào)的最小比例。圖1所示的曲線(xiàn)證明了這一指標(biāo)的重要意義，圖中示出了納米級(jí)金屬－氧化物半導(dǎo)體場(chǎng)效應(yīng)晶體管（mosfet）的柵極漏電流的測(cè)量結(jié)果。所測(cè)量到的電流的范圍從30fa變化到約170fa。這一測(cè)量需要的電流靈敏100aa（100e－18a）。無(wú)論何種情況，所要求的靈敏度都取決于應(yīng)用。圖1：納米mosfet的柵極漏電流范圍是30fa至約170fa
基于IP模塊的PCI接口設(shè)計(jì)及FPGA實(shí)現(xiàn)
境下的仿真驗(yàn)證；altera的pci core為ahdl格式，通過(guò)acf文件提供布局布線(xiàn)時(shí)的約束，其用戶(hù)側(cè)的信號(hào)數(shù)量較少，功能簡(jiǎn)單，便于實(shí)現(xiàn)；actel及quicklogic公司的反熔絲結(jié)構(gòu)，使其可編程芯片在速度與性能上有一定的優(yōu)勢(shì)，但pci核的功能則相對(duì)較弱。根據(jù)voip、cdma等先進(jìn)的通訊系統(tǒng)對(duì)pci總線(xiàn)接口的實(shí)際需求，我們通過(guò)評(píng)估比較，決定采用altera公司的64位66mhz pci core，在veribest及maxplusii nt設(shè)計(jì)平臺(tái)上，針對(duì)目標(biāo)器件flex10k 100e，利用vhdl硬件描述語(yǔ)言，設(shè)計(jì)了pci總線(xiàn)到摩托羅拉cpu的fpga橋接芯片。該芯片介于pci總線(xiàn)與摩托羅拉cpu之間，提供兩種總線(xiàn)間的地址轉(zhuǎn)換，命令譯碼，數(shù)據(jù)緩沖與傳輸，即插即用的配置，為系統(tǒng)的高速數(shù)據(jù)傳輸提供無(wú)縫的接口。 1．設(shè)計(jì)輸入設(shè)計(jì)輸入包括vhdl代碼設(shè)計(jì)及功能仿真。在進(jìn)行設(shè)計(jì)之前，先對(duì)系統(tǒng)劃分功能模塊，最頂層例化兩個(gè)模塊：altera的pci core和用戶(hù)側(cè)邏輯。用戶(hù)側(cè)邏輯根據(jù)功能再進(jìn)一步細(xì)化。vhdl的結(jié)構(gòu)化特點(diǎn)非常便于層次化設(shè)計(jì)，每個(gè)工程師負(fù)責(zé)完成功能相對(duì)獨(dú)立的各子
淺談射頻電容ESR的選用及應(yīng)用
有采取措施降低損耗，成象分辨率就會(huì)降低。atc100系列陶瓷電容組具有超低損耗，因而經(jīng)常用于線(xiàn)圈電路。這些電容組在諧振電路中發(fā)揮功能，卻不增加整個(gè)線(xiàn)路的損耗。 1. esr引起的電容功率耗散 esr乘以射頻網(wǎng)絡(luò)電流的平方就得到耗散在電容里的功率。所以耗散在電容里的功率可以表示為：pd=esrx(射頻電流)2或pd=esr x i2一個(gè)有趣的現(xiàn)象是，低損耗電容用于高射頻功率設(shè)備中時(shí)，設(shè)備功率可以是電容額定功率的幾百倍。下面是低esr電容這樣使用的一例。射頻功率＝1000瓦電容是atc100e102 （1000pf）頻率＝30mhzesr＝0.018 歐姆（18 毫歐姆）；設(shè)備線(xiàn)路阻抗＝50 歐姆。注意，100e系列最大允許功率耗散是大約5瓦。解：計(jì)算這一線(xiàn)路的射頻電流，再以電流計(jì)算電容中的射頻功率耗散。電流＝（功率/阻抗） 1/2 (這是這一線(xiàn)路內(nèi)的電流)（1000/50）1/2 =4.47 安培電容中實(shí)際耗散功率：p＝i2 x esr (這是電容將耗散的功率)p＝4.47 x 4.47 x 0.018 = 0.34 瓦。這個(gè)結(jié)果意味著在一個(gè)1000瓦

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