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2.供應商承諾此料號是“現(xiàn)貨” ，如果無貨或數(shù)量嚴重不足(實際數(shù)量不到顯示數(shù)量一半)，投訴成立獎勵您500元。
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ALTERA品牌專賣，一級代理可供更多
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TRANS GAN 100V 25A BUMPED DIE
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rom中讀取并行數(shù)據(jù)，然后串行送出。由于涉及到單片機編程，對于開發(fā)者來說較為不便；另外，如果單片機僅用來實現(xiàn)該任務，較為浪費硬件資源。cpld的一個最大優(yōu)點是采用計算機專用開發(fā)工具，通過jtag口直接一次性實現(xiàn)編程數(shù)據(jù)加載，但是由于acex 1k器件sram的易失性使數(shù)據(jù)無法永久保存，為調(diào)試帶來很大的不便，特別是從事野外作業(yè)者。 目前，altera公司推出了相應的配置器件。在cpld器件配置過程中，配置數(shù)據(jù)存儲在配置器件的eprom中，通過配置器件內(nèi)部振蕩器產(chǎn)生的時鐘控制數(shù)據(jù)輸出。本文以20腳epc2器件（以下簡稱epc2）為例闡述配置器件與acex 1k系列器件的連接。 3 epc2器件簡介 epc2具有flash配置存儲器,可用來配置5.0v、3.3v、2.5v器件。通過內(nèi)置的ieee std. 1149. 1 jtag接口epc2可以在5.0v和3.3v電壓下進行在系統(tǒng)編程（isp）。 系統(tǒng)編程后，調(diào)入jtag配置指令初始化acex 1k器件。epc2的isp能力使acex 1k器件的初始和更新更容易。當用epc2配置acex 1k器件時，在配置器件的內(nèi)部發(fā)生帶電復位延遲，最大值
出。由于涉及到單片機編程，對于開發(fā)者來說較為不便；另外，如果單片機僅用來實現(xiàn)該任務，較為浪費硬件資源。cpld 的一個最大優(yōu)點是采用計算機專用開發(fā)工具，通過jtag 口直接一次性實現(xiàn)編程數(shù)據(jù)加載，但是由于acex 1k 器件sram 的易失性使數(shù)據(jù)無法永久保存，為調(diào)試帶來很大的不便，特別是從事野外作業(yè)者。 目前，altera 公司推出了相應的配置器件。在cpld 器件配置過程中，配置數(shù)據(jù)存儲在配置器件的eprom 中，通過配置器件內(nèi)部振蕩器產(chǎn)生的時鐘控制數(shù)據(jù)輸出。本文以20 腳epc2 器件（以下簡稱epc2）為例闡述配置器件與acex 1k 系列器件的連接。 3 epc2 器件簡介 epc2 具有flash 配置存儲器,可用來配置5.0v、3.3v、2.5v 器件。通過內(nèi)置的ieee std.1149. 1 jtag 接口epc2 可以在5.0v 和3.3v 電壓下進行在系統(tǒng)編程（isp）。 系統(tǒng)編程后，調(diào)入jtag 配置指令初始化acex 1k 器件。epc2 的isp 能力使acex 1k 器件的初始和更新更容易。當用epc2 配置a
fpga采用altera公司epf10k30atc144，該器件內(nèi)核采用3.3 v供電，端口電壓為3．3v可承受5 v輸入高電平，其工作頻率高達100 mhz；有102個可用i／0端口，每個端口輸入電流最高達25 ma，輸出電流達25 ma；l728個邏輯單元(les)，12 288 bit的用戶flash存儲器，可滿足用戶小容量信息存儲，完全滿足系統(tǒng)設計要求。 由于fpga基于ram工藝技術(shù)，該器件丁作前需要從外部加載配置數(shù)據(jù)，需要一個外置存儲器保存信息，采用可編程的串行配置器件epc2．其供電電壓為3．3 v。oe和ncs引腳具有內(nèi)部用戶可配置上拉電阻。fpga的dclk、data0、nconfig引腳信號均來自epc2。系統(tǒng)上電后，首先fpga初始化，nstatus、conf_done置為低電平。nstatus置為低電平后復位，此時epc2的nce為低電平，因此選取epc2，從而數(shù)據(jù)流從data引腳輸入到fpga的datao引腳。配置完成后，fpga將conf_done置為高電平，而epc2將data引腳置為高阻態(tài)。其fpga配置電路如圖2所示。 2．2 按鍵電路
fpga采用altera公司epf10k30atc144，該器件內(nèi)核采用3.3 v供電，端口電壓為3．3v可承受5 v輸入高電平，其工作頻率高達100 mhz；有102個可用i／0端口，每個端口輸入電流最高達25 ma，輸出電流達25 ma；l728個邏輯單元(les)，12 288 bit的用戶flash存儲器，可滿足用戶小容量信息存儲，完全滿足系統(tǒng)設計要求。 由于fpga基于ram工藝技術(shù)，該器件丁作前需要從外部加載配置數(shù)據(jù)，需要一個外置存儲器保存信息，采用可編程的串行配置器件epc2．其供電電壓為3．3 v。oe和ncs引腳具有內(nèi)部用戶可配置上拉電阻。fpga的dclk、data0、nconfig引腳信號均來自epc2。系統(tǒng)上電后，首先fpga初始化，nstatus、conf_done置為低電平。nstatus置為低電平后復位，此時epc2的nce為低電平，因此選取epc2，從而數(shù)據(jù)流從data引腳輸入到fpga的datao引腳。配置完成后，fpga將conf_done置為高電平，而epc2將data引腳置為高阻態(tài)。其fpga配置電路如圖2所示。 2．2 按鍵
fpga采用altera公司epf10k30atc144，該器件內(nèi)核采用3.3 v供電，端口電壓為3．3v可承受5 v輸入高電平，其工作頻率高達100 mhz；有102個可用i／0端口，每個端口輸入電流最高達25 ma，輸出電流達25 ma；l728個邏輯單元(les)，12 288 bit的用戶flash存儲器，可滿足用戶小容量信息存儲，完全滿足系統(tǒng)設計要求。 由于fpga基于ram工藝技術(shù)，該器件丁作前需要從外部加載配置數(shù)據(jù)，需要一個外置存儲器保存信息，采用可編程的串行配置器件epc2．其供電電壓為3．3 v。oe和ncs引腳具有內(nèi)部用戶可配置上拉電阻。fpga的dclk、data0、nconfig引腳信號均來自epc2。系統(tǒng)上電后，首先fpga初始化，nstatus、conf_done置為低電平。nstatus置為低電平后復位，此時epc2的nce為低電平，因此選取epc2，從而數(shù)據(jù)流從data引腳輸入到fpga的datao引腳。配置完成后，fpga將conf_done置為高電平，而epc2將data引腳置為高阻態(tài)。其fpga配置電路如圖2所示。 2．2 按鍵電路
問個配置的問題？altera手冊上說，根據(jù)文件．rbf的大小，可以用epc2配置ep1k100，我現(xiàn)在的情況是文件．rbf小于epc2的容量，但是需要下載到epc2的文件.pof卻大于epc2的容量，請問還能用一片epc2配置么？
請教下載程序問題，急！馬上要畫板子了才發(fā)現(xiàn)還有個很急的問題不清楚，我用的軟件是quartusii5.0_sp1_web版本的，fpga是epf10k30rc240，配置芯片是epc2，怎么樣把程序下載到配置芯片epc2里？第一次用，呵呵 剛才我在軟件里點“programmer”，在出來的下載程序頁面點“add device”，在這里面選epc2就行了是么？還是epc2ep和f10k30rc都得選？
請教下載程序問題，急！馬上要畫板子了才發(fā)現(xiàn)還有個很急的問題不清楚，我用的軟件是quartusii5.0_sp1_web版本的，fpga是epf10k30rc240，配置芯片是epc2，怎么樣把程序下載到配置芯片epc2里？第一次用，呵呵 剛才我在軟件里點“programmer”，在出來的下載程序頁面點“add device”，在這里面選epc2就行了是么？還是epc2ep和f10k30rc都得選？
再問一下高手:關(guān)于fpga的下載配置問題!我看有的是通過jtag直接同時下載到epc2和fpga里.我是通過jtag下載到epc2里,然后由epc2自動配置fpga,這樣應該可以吧!
新手請教 我用max+plux2向epc2里下程序怎么下不進去，電路配置沒有問題，我在jtag設置的選項里設置器件為epc2，下載文件為。pof文件，不對嗎？他總是提示epc2不適用。pof的下載，請教大家是怎么回事，怎么設置才能下載，謝謝。
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