SmafiGuide技術(shù)

SmafiGuide是ISE中另外一種設(shè)計(jì)重用技術(shù)，它根據(jù)戶指定的NCD文件來(lái)指導(dǎo)新的布局布線過(guò),從而達(dá)到以較短的時(shí)間實(shí)現(xiàn)時(shí)序收斂．刈于一些比較敏感的時(shí)序路徑或布局也會(huì)自動(dòng)地進(jìn)行調(diào)整，以便滿足時(shí)序要求．該技術(shù)適用于后...

分類：EDA/PLD/PLC 時(shí)間：2008-09-11 閱讀：2915 關(guān)鍵詞：SmafiGuide技術(shù)FPGASmafiGuide布線

Partition技術(shù)

中為需要做設(shè)計(jì)重用或者希望保留上次實(shí)現(xiàn)結(jié)果的模塊設(shè)定Partition屬性。Partition設(shè)定的對(duì)象可以是設(shè)計(jì)中任意層次的任意模塊，這些設(shè)計(jì)可以是HDL代碼、EDIF網(wǎng)表，甚至是原理圖格式。為設(shè)計(jì)模塊設(shè)定了Partition屬性以...

分類：EDA/PLD/PLC 時(shí)間：2008-09-11 閱讀：3305 關(guān)鍵詞：Partition技術(shù)PartitionHDL

論eASIC如何實(shí)現(xiàn)ASIC設(shè)計(jì)趨勢(shì)

摘要：深亞微米ASIC設(shè)計(jì)趨勢(shì)衰退的若干主要原因，分析兩種替代ASIC的器件FPGA和結(jié)構(gòu)化ASIC的長(zhǎng)短處，介紹eASIC公司的新一代45nm結(jié)構(gòu)化ASIC中的技術(shù)。闡明了深亞微米時(shí)代eASIC結(jié)構(gòu)化ASIC的路越走越寬。深亞微米ASIC設(shè)...

分類：EDA/PLD/PLC 時(shí)間：2008-09-11 閱讀：1763 關(guān)鍵詞：論eASIC如何實(shí)現(xiàn)ASIC設(shè)計(jì)趨勢(shì)eASICASICFPGA

科威通用PLC EC-16M16R

產(chǎn)品簡(jiǎn)介：黃石科威自控有限公司生產(chǎn)的32點(diǎn)開關(guān)型通用可編程控制器具有開關(guān)型PLC所有的功能，用戶工藝可用梯形圖語(yǔ)言編程，編程軟件兼容三菱FX2N編程軟件。詳細(xì)介紹：黃石科威自控有限公司生產(chǎn)的32點(diǎn)開關(guān)型通用可編...

分類：EDA/PLD/PLC 時(shí)間：2008-09-10 閱讀：2708 關(guān)鍵詞：科威通用PLC EC-16M16RRS485

科威通用　型號(hào)EP-08M08R

產(chǎn)品簡(jiǎn)介：性價(jià)比極高的微型PLC,操作靈活/簡(jiǎn)便,滿足中/小規(guī)模控制系統(tǒng)要求。詳細(xì)介紹：1、具有8點(diǎn)輸入，8點(diǎn)輸出的開關(guān)型通用PLC.2、具有梯形圖編程接口，可連接計(jì)算機(jī)或人機(jī)界面。3、具有RS485網(wǎng)絡(luò)接口，可作RS485網(wǎng)...

分類：EDA/PLD/PLC 時(shí)間：2008-09-10 閱讀：2745 關(guān)鍵詞：科威通用　型號(hào)EP-08M08RRS485

三凌推出FX1S-30MT-001PLC

產(chǎn)品簡(jiǎn)介：FX1S-30MR-001FX1S-30MT-001是30路I/O小型可編程控制器,是一種數(shù)字量輸入輸出接口的性能比較高的PLC。它是為滿足市場(chǎng)對(duì)30路以下低價(jià)格、高性能PLC的需求設(shè)計(jì)的，可靈活運(yùn)用在各種工業(yè)自動(dòng)控制場(chǎng)合。詳細(xì)介...

分類：EDA/PLD/PLC 時(shí)間：2008-09-10 閱讀：2666 關(guān)鍵詞：三凌推出FX1S-30MT-001PLCFX1S-30MR-001RS485EEPROMFX1S-30MT-001

使用FPGA底層編輯器二

在執(zhí)行這些操作前，一定要先保存.NCD和NCF文件。因?yàn)槿魏蔚讓泳庉嬈鞯牟僮鞫紩?huì)修改這些文件，一旦修改有誤，將無(wú)法恢復(fù)原始設(shè)計(jì)，造成不必要的損失。 　　■移動(dòng)邏輯資源；在底層編輯器中可以將一個(gè)邏輯單元（塊）...

分類：EDA/PLD/PLC 時(shí)間：2008-09-10 閱讀：1919 關(guān)鍵詞：使用FPGA底層編輯器二CTRLNAMESELECTPINSDESIGNERRORFPGA

使用FPGA底層編輯器一

在Place ＆ Route布局布線流程中雙擊【View／Edit Routed Design（FPGA Editor）】選項(xiàng)，出現(xiàn)圖1所示的界面。在布局布線流程中運(yùn)行底層編輯器與映射（Map）流程中執(zhí)行的結(jié)果是有區(qū)別的，其中包含所有布線的詳細(xì)信息...

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FPGA底層編輯器的用戶界面

如圖1所示，在【Processes for Source：…】窗口中選擇【Implement Design】→【Map】－【 Manually Place＆Route（FPGA Editor）】命令，或在【Place ＆ Route】布局布線流程中執(zhí)行【View／EditRouted Design（FPGA...

分類：EDA/PLD/PLC 時(shí)間：2008-09-10 閱讀：1702 關(guān)鍵詞：FPGA底層編輯器的用戶界面DESIGNFPGA

FPGA底層編輯器相關(guān)的輸入／輸出文件

FPGAEditor相關(guān)文件如下。（1）輸入文件.NCD：該文件由映射（Map）流程或布局布線（Place＆Route）流程生成，使用FPGAEditor可以編輯NCD文件，也可以將最后的結(jié)果保存為NCD文件。（2）輸出文件.PCF：物理約束（PC

分類：EDA/PLD/PLC 時(shí)間：2008-09-10 閱讀：2164 關(guān)鍵詞：FPGA底層編輯器相關(guān)的輸入／輸出文件FPGA編輯器

FPGA底層編輯器概述

盡管ISE10.x設(shè)計(jì)工具提供了功能強(qiáng)大的智能化綜合及實(shí)現(xiàn)等模塊，但在對(duì)邏輯進(jìn)行高級(jí)設(shè)計(jì)的過(guò)程中仍然需要采用手動(dòng)布局布線的方式才能達(dá)到?jīng)]計(jì)要求。FPGAEditor工具為設(shè)計(jì)者提供豐富的FPGA底層編輯功能，主要體現(xiàn)在以...

分類：EDA/PLD/PLC 時(shí)間：2008-09-10 閱讀：1738 關(guān)鍵詞：FPGA底層編輯器概述XILINXFPGA

利用可編程邏輯實(shí)現(xiàn)靈活高效的多媒體信號(hào)處理

從非常簡(jiǎn)單的消費(fèi)類音/視頻播放器到在制作環(huán)境中使用的高度復(fù)雜的音視頻捕捉、編輯和回放系統(tǒng)，多媒體設(shè)備或系統(tǒng)的應(yīng)用范圍非常廣泛。人們?cè)趯?shí)現(xiàn)這類應(yīng)用系統(tǒng)時(shí)會(huì)使用特殊應(yīng)用標(biāo)準(zhǔn)產(chǎn)品(ASSP)、專用數(shù)字信號(hào)處理器(DS...

分類：EDA/PLD/PLC 時(shí)間：2008-09-05 閱讀：1935 關(guān)鍵詞：利用可編程邏輯實(shí)現(xiàn)靈活高效的多媒體信號(hào)處理可編程邏輯多媒體信號(hào)處理

EDA技術(shù)的發(fā)展與應(yīng)用

摘要：隨著微電子技術(shù)和計(jì)算機(jī)技術(shù)的不斷發(fā)展，在涉及通信、國(guó)防、航天、工業(yè)自動(dòng)化、儀器儀表等領(lǐng)域的電子系統(tǒng)設(shè)計(jì)工作中，ＥＤＡ技術(shù)的含量正以驚人的速度上升，它已成為當(dāng)今電子技術(shù)發(fā)展的前沿之一。本文首先闡述...

分類：EDA/PLD/PLC 時(shí)間：2008-09-03 閱讀：3063 關(guān)鍵詞：EDA技術(shù)的發(fā)展與應(yīng)用EDA

LATTICE ispLEVER CLASSIC 1.2版設(shè)計(jì)工具包上市

Lattice宣布其ispLEVERClassicversion1.2版設(shè)計(jì)工具包即將上市。該工具包支持Lattice公司所有系列的SPLD、CPLD和部分FPGA。Lattice的ispLEVERClassic設(shè)計(jì)軟件現(xiàn)可對(duì)新推出的超低功率isp

分類：EDA/PLD/PLC 時(shí)間：2008-08-29 閱讀：3472 關(guān)鍵詞：LATTICE ispLEVER CLASSIC 1.2版設(shè)計(jì)工具包上市HDL仿真CLASSIC 1.2

ESD引起集成電路損壞原理模式及實(shí)例

一.ESD引起集成電路損傷的三種途徑(1)人體活動(dòng)引起的摩擦起電是重要的靜電來(lái)源，帶靜電的操作者與器件接觸并通過(guò)器件放電。(2)器件與用絕緣材料制作的包裝袋、傳遞盒和傳送帶等摩擦，使器件本身帶靜電，它與人體或地...

分類：EDA/PLD/PLC 時(shí)間：2008-08-27 閱讀：1859 關(guān)鍵詞：ESD引起集成電路損壞原理模式及實(shí)例54LS10LF25354S1813DG142

采用PLC實(shí)現(xiàn)空壓站自動(dòng)化控制

在棉紡織企業(yè)廣泛使用噴氣織機(jī)的情況下，空壓站建設(shè)是一項(xiàng)重要的輔助工程。在天津紡織園區(qū)所有空壓站配備的主要設(shè)備為離心式空氣壓縮機(jī)、冷凍式空氣干燥器，通過(guò)儲(chǔ)氣罐、連接管道和閥門等組成壓縮空氣供氣系統(tǒng)，并配...

分類：EDA/PLD/PLC 時(shí)間：2008-08-26 閱讀：1785 關(guān)鍵詞：采用PLC實(shí)現(xiàn)空壓站自動(dòng)化控制RS422/485PLC

選擇高效ESD保護(hù)器件的訣竅

隨著更新的集成電路(IC)技術(shù)采用更小的幾何尺寸和更低的工作電壓，不斷更新?lián)Q代的便攜產(chǎn)品對(duì)靜電放電(ESD)電壓損害越來(lái)越敏感。有鑒于此，手機(jī)、MP3播放器和數(shù)碼相機(jī)等便攜產(chǎn)品的設(shè)計(jì)人員必須評(píng)估各種可供選擇的ESD...

分類：EDA/PLD/PLC 時(shí)間：2008-08-25 閱讀：2316 關(guān)鍵詞：選擇高效ESD保護(hù)器件的訣竅RSB6.8CSESD

eASIC如何實(shí)現(xiàn)ASIC價(jià)值重歸

前言在市場(chǎng)需求的驅(qū)動(dòng)下，為了提高速度、減少功耗、降低成本，半導(dǎo)體工藝遵循著摩爾定律，已經(jīng)跨入深亞微米DSM時(shí)代。從180nm、130nm、90nm、65nm，再細(xì)到45nm。32nm、22nm似乎就在不遠(yuǎn)的將來(lái)。若再往下縮減，晶體管...

分類：EDA/PLD/PLC 時(shí)間：2008-08-22 閱讀：1809 關(guān)鍵詞：eASIC如何實(shí)現(xiàn)ASIC價(jià)值重歸eASICASIC